yandex
E
etchedai
Страна
США
В офисеПолная занятость

Front-End Power Engineer

ИИОценка ИИ

Исключительно привлекательная вакансия в перспективном стартапе, работающем над прорывными ИИ-чипами. Предлагаются отличные бонусы (100% страховка, субсидия на жилье) и возможность быть на острие технологий.

Сформировано ИИ автоматически. Не является проверкой вакансии или работодателя.


Вакансия из открытого источника
Пожаловаться
+400% приглашений от HR

Улучшите резюме под эту вакансию

Возьмём требования и создадим новую версию резюме с акцентом на нужный опыт

Сложность вакансии

ЛегкоСложно
ИИОценка ИИ

Роль требует глубоких экспертных знаний в проектировании микросхем (ASIC/RTL) и специфических инструментов анализа мощности. Высокая сложность обусловлена необходимостью оптимизации на уровне железа для передовых ИИ-архитектур.

Сформировано ИИ автоматически. Не является проверкой вакансии или работодателя.

Анализ зарплаты

Медиана195 000 $
Рынок155 000 $ – 260 000 $
ИИОценка ИИ

Зарплата для данной позиции в Купертино (Кремниевая долина) для инженеров такого уровня обычно начинается от $160,000 и может достигать $250,000+ без учета опционов. Учитывая стадию стартапа и сложность задач, предложение должно быть в верхнем сегменте рынка.

Сформировано ИИ автоматически. Не является проверкой вакансии или работодателя.

Сопроводительное письмо

Составьте сопроводительное письмо под эту вакансию с вашим резюме

Иллюстрация сопроводительного письмаИллюстрация сопроводительного письма

Описание вакансии

About Etched

Etched is building AI chips that are hard-coded for individual model architectures. Our first product (Sohu) only supports transformers, but has an order of magnitude more throughput and lower latency than a B200. With Etched ASICs, you can build products that would be impossible with GPUs, like real-time video generation models and extremely deep & parallel chain-of-thought reasoning agents.

Key responsibilities

  • Optimize RTL designs to boost power efficiency while meeting performance and area objectives.
  • Perform power analysis throughout various stages of silicon design, applying power-saving strategies in RTL such as clock gating, power gating, multi-voltage domains, and dynamic voltage scaling.
  • Conduct power estimation and evaluate PPA trade-offs for both new and existing design features.
  • Collaborate closely with the physical design team to ensure power targets are met during the synthesis, place-and-route (P&R), and sign-off phases.
  • Create precise power models from RTL simulations and gate-level netlists, and perform power roll-up analysis to estimate chip-level power consumption under different conditions.

You may be a good fit if you have

  • Experience in RTL development using Verilog/SystemVerilog, with a focus on low-power RTL design and optimization for complex digital systems.
  • In-depth knowledge and experience in implementing low-power techniques like clock gating, power gating, and dynamic voltage/frequency scaling (DVFS).
  • Familiarity with synthesis and place-and-route processes with an emphasis on optimizing for power.

Strong candidates may also have experience with

  • UPF/CPF power intent specifications.
  • Power analysis tools such as Synopsys PrimePower, Cadence Joules, or similar.
  • Automation of power analysis and optimization workflows using scripting languages (Tcl, Perl, Python).

Benefits

  • Full medical, dental, and vision packages, with 100% of premium covered
  • Housing subsidy of $2,000/month for those living within walking distance of the office
  • Daily lunch and dinner in our office
  • Relocation support for those moving to Cupertino

How we’re different

Etched believes in the Bitter Lesson. We think most of the progress in the AI field has come from using more FLOPs to train and run models, and the best way to get more FLOPs is to build model-specific hardware. Larger and larger training runs encourage companies to consolidate around fewer model architectures, which creates a market for single-model ASICs.

We are a fully in-person team in Cupertino, and greatly value engineering skills. We do not have boundaries between engineering and research, and we expect all of our technical staff to contribute to both as needed.

Больше похожих вакансий + автоотклики с ИИ

Умный подбор, сопроводительные письма, советы по отказам — больше приглашений.

Больше похожих вакансий + автоотклики с ИИ

Навыки

  • RTL Design
  • Verilog
  • SystemVerilog
  • ASIC
  • Low Power Design
  • Clock Gating
  • Power Gating
  • DVFS
  • Synthesis
  • Place and Route
  • UPF
  • CPF
  • Synopsys PrimePower
  • Cadence Joules
  • TCL
  • Perl
  • Python

Возможные вопросы на собеседовании

Проверка фундаментальных знаний методов снижения энергопотребления в цифровых схемах.

Можете ли вы подробно описать различия в реализации и влиянии на PPA между техниками clock gating и power gating?

Оценка опыта работы с отраслевыми стандартами описания намерений по питанию.

Расскажите о вашем опыте работы с UPF (Unified Power Format). С какими сложностями вы сталкивались при определении доменов питания?

Проверка навыков использования специализированного ПО для анализа.

Каков ваш типичный рабочий процесс (workflow) при использовании Synopsys PrimePower для оценки мощности на уровне gate-level netlist?

Оценка способности находить баланс между скоростью и энергопотреблением.

Как вы подходите к анализу PPA trade-offs, когда требования по производительности вступают в конфликт с лимитами по тепловыделению?

Проверка навыков автоматизации, критически важных для эффективности инженера.

Приведите пример того, как вы использовали Python или Tcl для автоматизации рутинных задач анализа мощности или обработки отчетов.

Сформировано ИИ автоматически. Не является проверкой вакансии или работодателя.

Похожие вакансии

E
etchedai
США
более 1000 офферов получено
4.9

1000+ офферов получено

Устали искать работу? Мы найдём её за вас

Quick Offer улучшит ваше резюме, подберёт лучшие вакансии и откликнется за вас. Результат — в 3 раза больше приглашений на собеседования и никакой рутины!